假設(shè)某存儲器總線采用同步通信方式，時鐘頻率為50MHz時鐘，每個總線事務(wù)以突發(fā)方式傳輸8個字，以支持塊長為8個字的Cache行讀和Cache行寫，每字4字節(jié)。對于讀操作，訪問順序是1個時鐘周期接受地址，3個時鐘周期等待存儲器讀數(shù)，8個時鐘周期用于傳輸8個字。對于寫操作，訪問順序是1個時鐘周期接受地址，2個時鐘周期延遲，8個時鐘周期用于傳輸8個字，3個時鐘周期恢復(fù)和寫入糾錯碼。對于以下訪問模式，求出該存儲器讀/寫時在存儲器總線上的帶寬。
①全部訪問為連續(xù)的讀操作；
②全部訪問為連續(xù)的寫操作；
③65%的訪問為讀操作，35%的訪問為寫操作。
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一臺機器要求浮點數(shù)的字長的精度不低于10-7.2，表數(shù)的范圍正數(shù)不小于1038，且正負對稱。尾數(shù)用原碼、純小數(shù)表示，階碼用移碼、整數(shù)表示。設(shè)計這種浮點數(shù)的格式。
設(shè)計8位字長的寄存器—寄存器型指令3條，16位字長的寄存器一存儲器型變址尋址方式指令4條，變址范圍不小于正、負127。請設(shè)計指令格式，并給出指令各字段的長度和操作碼的編碼。
至少要分配給該程序多少個主存頁面才能獲得最高的命中率？
設(shè)16個處理器編號分別為0，1，…，15，要用單級互連網(wǎng)絡(luò)，當(dāng)互連函數(shù)分別為：（1）Cube3（Cube1）（5）Butterfly（Butterfly）（8）σ-1（9）β（1）（13）ρ（2）時，第13號處理器分別與哪一個處理器相連？
在有16個處理器的均勻洗牌網(wǎng)絡(luò)中，若要使第0號處理器與第15號處理器相連，需要經(jīng)過多少次均勻洗牌和交換置換。
若在程序執(zhí)行過程中，每從主存裝入一塊到Cache，平均要對這個塊訪問16次，計算在這種情況下的Cache命中率。
浮點數(shù)系統(tǒng)使用的階碼基值re=2，階值位數(shù)q=2，尾數(shù)基值rm=10，尾數(shù)位數(shù)p′=1，即按照使用的二進制位數(shù)來說，等價于p=4。計算在非負階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個數(shù)。
共需要多少個觸發(fā)器和多少個與門？
如果N=100，采用指令取消技術(shù)后，在程序執(zhí)行過程中，能夠節(jié)省多少個指令周期？
為了使存儲系統(tǒng)的訪問效率從0.5提高到0.94，塊的大小至少增加到幾個字？