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在Verilog HDL中,使用()關(guān)鍵字說明事件時有輸入信號的上述沿觸發(fā)的;使用()關(guān)鍵字聲明事件是由輸入信號的下降沿觸發(fā)的。
答案:
posedge;negedge
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填空題
在Verilog HDL的if語句中,系統(tǒng)對表達(dá)式的值進(jìn)行判斷,若值為0,x或z,則按()處理,若為1,則按()處理。
答案:
假;真
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在Verilog HDL的非阻塞賦值語句中,賦值號是(),賦值變量必須是()型變量。
答案:
<=;reg
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