由圖7-58所示數(shù)字邏輯信號(hào)的波形可知，三者的邏輯關(guān)系是（）。
A.
B.
C.
D.
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A.0，1
B.1，0
C.，X
D.X，
如圖7-57所示，將放大倍數(shù)為1，輸入電阻為1kΩ，，輸出電阻為50Ω的射極輸出器插接在信號(hào)源（uS，RS）與負(fù)載（RL）之間，形成圖b電路，與圖a電路相比，負(fù)載電壓的有效值為（）。
A.
B.
C.
D.因?yàn)閡S未知，不能確定之間的關(guān)系
共集電極放大電路如圖7-56所示。已知：β=50，，當(dāng)輸入正弦電壓有效值Ui=7.5mV，輸出電壓有效值U0最接近于（）。
A.1.5V
B.-0.7V
C.-15.6mV
D.7.5mV
圖7-55a所示運(yùn)算放大器的輸出與輸入之間的關(guān)系如圖7-55b所示，若Ui=2sinωtmV，則u0為（）。
A.
B.
C.
D.
A.輸出電壓與輸入電壓反相，無(wú)電壓放大，有電流放大作用
B.輸出電壓與輸入電壓同相，有電壓放大，無(wú)電流放大作用
C.電路的輸入電阻高，輸出電阻低，無(wú)電壓放大，有電流放大作用
D.電路的輸入電阻低，輸出電阻高，既有電壓放大，也有電流放大作用
最新試題
欲使JK觸發(fā)器按工作，可使JK觸發(fā)器的輸入端（）。
如圖7-70所示電路，Q1、Q2原始狀態(tài)為11，當(dāng)輸入兩個(gè)脈沖后的新?tīng)顟B(tài)為（）。
下列各電路能正常放大交流信號(hào)的是（）。
某邏輯電路如圖7-62所示，若輸入A=1，B=0，則輸出F1和F2分別為（）。
邏輯表達(dá)式，可以簡(jiǎn)化為（）。
如圖7-72所示，時(shí)鐘到來(lái)后，JK具有（）功能。
用3個(gè)D觸發(fā)器組成的電路如圖7-69所示，觸發(fā)器F0的輸入端接+5V表明D0=1，那么，在第1個(gè)CP脈沖和第2個(gè)脈沖的上升沿過(guò)后Q2Q1Q0分別是（）。
用3個(gè)D觸發(fā)器組成的電路如圖7-68所示，設(shè)Q2Q1Q0的初始狀態(tài)為000，觸發(fā)器F0的輸入端接+5V表明D0=1，那么，在第1個(gè)CP脈沖和第2個(gè)脈沖的上升沿過(guò)后Q2Q1Q0分別是（）。
邏輯變量X與1異或結(jié)果是（），與0異或的結(jié)果是（）。
測(cè)量常開(kāi)常閉觸點(diǎn)時(shí)，需要使用萬(wàn)用表的（）