A.TTL集成電路
B.PMOS集成電路
C.NMOS集成電路
D.CMOS集成電路
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A.電阻
B.電容
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A.輸入低電平時(shí)，三極管工作在截止區(qū)，輸出為高電平。
B.輸入高電平時(shí)，三極管工作在飽和區(qū)，輸出為低電平。
C.輸入低電平時(shí)，三極管工作在截止區(qū)，輸出為低電平。
D.輸入高電平時(shí)，三極管工作在飽和區(qū)，輸出為高電平。
A.電阻
B.電位器
C.二極管
D.三極管
最新試題
根據(jù)什么判斷簡單電路中的險(xiǎn)象存在？
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡述它們的作用。
以下代碼中為無權(quán)碼的為（）。
TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
7系列EPROM存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是（）。
利用2個(gè)74LS138和1個(gè)非門，可以擴(kuò)展得到1個(gè)（）線譯碼器。
判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案，比較各種方案的特點(diǎn)。如果用HDPLD來實(shí)現(xiàn)，設(shè)計(jì)方案是最佳嗎？簡述理由。