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你可能感興趣的試題
A.地址寄存器
B.地址寄存器和指令寄存器
C.地址寄存器和數(shù)據(jù)緩沖寄存器
D.地址寄存器、數(shù)據(jù)緩沖寄存器和指令寄存器
A.階碼部件可實(shí)現(xiàn)加、減、乘、除四種運(yùn)算
B.階碼部件只進(jìn)行階碼相加、相減和比較操作
C.階碼部件只進(jìn)行階碼相加、相減操作
D.尾數(shù)部件只進(jìn)行乘法和除法運(yùn)算
A.一個(gè)以上,與非門
B.一個(gè),三態(tài)緩沖器
C.n個(gè),三態(tài)緩沖器
D.n個(gè)以上,或非門
A.非晶硅
B.單晶硅
C.多晶硅
D.硫化鎘
最新試題
可能的最高頁命中率是多少?
如果一條指令的執(zhí)行過程分解為“取指令”和“分析”兩個(gè)階段,并采用兩級(jí)流水線。為了采用指令取消技術(shù),請(qǐng)修改上面的程序。
指出主存與Cache之間各個(gè)塊的映象關(guān)系。
為了使存儲(chǔ)系統(tǒng)的訪問效率達(dá)到0.94,命中率和等效訪問周期應(yīng)該提高到多少?
有一個(gè)16KB4路組相聯(lián)Cache的32位微處理器,假定該Cache的塊為4個(gè)32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
設(shè)計(jì)8位字長(zhǎng)的寄存器—寄存器型指令3條,16位字長(zhǎng)的寄存器一存儲(chǔ)器型變址尋址方式指令4條,變址范圍不小于正、負(fù)127。請(qǐng)?jiān)O(shè)計(jì)指令格式,并給出指令各字段的長(zhǎng)度和操作碼的編碼。
考慮題目全部要求,設(shè)計(jì)優(yōu)化實(shí)用的操作碼形式,并計(jì)算其操作碼的平均碼長(zhǎng)。
為了使存儲(chǔ)系統(tǒng)的訪問效率從0.5提高到0.94,塊的大小至少增加到幾個(gè)字?
僅根據(jù)使用頻度,不考慮其它要求,設(shè)計(jì)出全Huffman操作碼,計(jì)算其平均碼長(zhǎng)。
若Cache的4個(gè)塊號(hào)為C0、C1、C2和C3,列出程序執(zhí)行過程中的Cache塊地址流。