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A.電壓調(diào)整率
B.電流調(diào)整率
C.穩(wěn)壓系數(shù)
D.不確定
A.負(fù)載電流大
B.負(fù)載電流小
C.電路復(fù)雜
D.輸出電壓可調(diào)
A.工作正常
B.接反
C.已經(jīng)擊穿
D.不確定
A.調(diào)試方便
B.輸出電壓不可調(diào)
C.輸出電壓穩(wěn)定度高且可調(diào)節(jié)
D.輸出電流小
A.三端式穩(wěn)壓器，輸出負(fù)電壓可調(diào)
B.多端式穩(wěn)壓器，輸出電壓可調(diào)
C.多端式穩(wěn)壓器，負(fù)穩(wěn)壓器
D.多端式穩(wěn)壓器，正穩(wěn)壓器
最新試題
?已知Nexys4開發(fā)板外部時鐘信號頻率為100MHz，數(shù)字鐘用來產(chǎn)生秒信號的時鐘信號頻率為1Hz，若采用計數(shù)器對100MHz的外部時鐘分頻得到1Hz的秒信號，請問該計數(shù)器至少需要多少位？（）
?CS放大器中引入源極電阻RS，其作用有（）。?
?MOSFET源極漏極間的長度L越大，溝道長度調(diào)制效應(yīng)越明顯。???
?CS、CG和CD三種組態(tài)中，最適合做電壓放大器的還是CS放大器。
?TTL或非門組成的邏輯電路如圖所示，當(dāng)輸入為以下哪種狀態(tài)時會出現(xiàn)冒險現(xiàn)象？（）
假設(shè)NEMOSFET已工作在飽和區(qū)，若uDS繼續(xù)增大時，溝道夾斷點向漏極移動。
?CG放大器的性能描述合理的是（）。
在下圖中如果輸入輸出均有電容耦合，則將RG的阻值由10MΩ替換為1MΩ時，柵極直流電壓將會（），漏極直流電流將會（），輸入電阻將會（）。
?verilogHDL中已經(jīng)預(yù)先定義了的門級原型的符號有（）。
?5.1K±5%歐姆的五環(huán)電阻的色環(huán)序列為（）。