A.T2、T2
B.T2、T3
C.T3、T4
D.T3、T2
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A.表示讀數(shù)據(jù)對(duì)應(yīng)的高4位的地址
B.表示CPU當(dāng)前工作狀態(tài)
C.處于高阻狀態(tài)
D.處于不定狀態(tài)
A.總線周期通常由連續(xù)的T1～T4組成
B.在讀寫操作數(shù)時(shí)才執(zhí)行總線周期
C.總線周期允許插入等待狀態(tài)
D.總線周期允許存在空閑狀態(tài)
A.能中斷CPU的工作
B.能進(jìn)行DMA操作
C.其它總線部件不能占有總線
D.暫停CPU的工作
A.總線鎖定
B.地址鎖定
C.數(shù)據(jù)輸入鎖定
D.數(shù)據(jù)輸出鎖定
A.上升沿
B.下降沿
C.結(jié)束位置
D.中間位置
最新試題
容量為8K×8bit的存儲(chǔ)器芯片，該芯片的地址線有（）根，數(shù)據(jù)線有（）根。
ROL、ROR、RCL或RCR指令中的目的操作數(shù)可以是8/16位的寄存器或存儲(chǔ)器。（）
要組成32M×8bit的存儲(chǔ)器，需要1M×4bit的存儲(chǔ)芯片共（）片。
8255A的端口地址線是A0、A1，所以端口地址為0，1，2，3。（）
增計(jì)數(shù)模式的計(jì)數(shù)過(guò)程是（）。
SPI總線是一種（）形總線結(jié)構(gòu)，在SCLK時(shí)鐘信號(hào)的控制下，兩個(gè)雙向（）寄存器進(jìn)行數(shù)據(jù)交換。
按照是否需要刷新操作分類，RAM可分為（）和（）。
在一個(gè)較短的時(shí)間間隔內(nèi)，CPU訪問(wèn)存儲(chǔ)器時(shí)，無(wú)論是存取指令還是存取數(shù)據(jù)，所訪問(wèn)的存儲(chǔ)單元都趨于聚集在一個(gè)較小的連續(xù)區(qū)域中，而對(duì)此范圍以外的地址訪問(wèn)甚少的現(xiàn)象就稱為程序訪問(wèn)的（）性。
MSP430單片機(jī)的ADC12轉(zhuǎn)換結(jié)果緩沖的寄存器有（）個(gè)。
在嵌入式應(yīng)用系統(tǒng)中，模擬I2C時(shí)序擴(kuò)展比硬件I2C通信擴(kuò)展具有更大的靈活性。