A.VHDL語言是針對電路功能的描述,其語言具有并行特性
B.電路內(nèi)部的模塊之間用信號線進行連接,因此信號的傳遞具有延遲特性
C.其語言具有對電路模型及對外輸入輸出端口信號的定義,外部的封裝與管腳也是硬件特性的表現(xiàn)
D.語言與C語言類似,語句執(zhí)行是按照指令一條一條按順序執(zhí)行的
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A.實體名和文件名盡量一致,定義名稱由英文字母、下劃線和0-9的數(shù)字構成,結尾可以用下劃線和數(shù)字
B.實體名和文件名盡量一致,定義名稱由英文字母、下劃線和0-9的數(shù)字構成,其數(shù)字和下劃線只能放中間
C.實體名和文件名盡量一致,定義名稱由英文字母、下劃線和0-9的數(shù)字構成,只能用英文字母開頭,結尾不能用下劃線
D.實體名和文件名盡量一致,定義名稱由英文字母、下劃線和0-9的數(shù)字構成,開頭和結尾都無要求
A.所有數(shù)碼管在同一時間能被全部點亮(眼睛視角暫留時間),但同一時刻只有唯一的數(shù)碼管被點亮
B.所有數(shù)碼管在同一個時間不能被全部點亮(眼睛視角暫留時間)
C.所有數(shù)碼管在同一個時刻能被同時點亮
D.所有數(shù)碼管在同一時刻不能被全部點亮,眼睛看到的是一個一個被點亮
A.將設計好的語言進行綜合、布局布線、再生成BIT文件下載到FPGA芯片
B.將語言表達電路的端口信號與選定FPGA芯片的管腳進行關聯(lián),再編程產(chǎn)生下載到芯片需求的二進制代碼
C.選擇適合的器件將語言轉換成電路放入該芯片
D.將設計好的語言下載到FPGA芯片里
A.是將語言表達的電路,轉換成底層的門級電路圖
B.類似于仿真是對電路的功能進行驗證
C.綜合僅僅是對設計的語法進行檢查
D.等同于C語言中的設計編譯,產(chǎn)生底層的二進制機器代碼
A.設計仿真文件是對源文件的輸入信號進行波形給定
B.設計仿真文件是對源文件的輸入、輸出信號給定波形
C.設計仿真文件是對源文件的輸出信號進行波形給定
D.設計仿真文件與源文件是無關系
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