單項選擇題

對于VHDL以下幾種說法錯誤的是（）

A.VHDL程序中是區(qū)分大小寫的。
B.一個完整的VHDL程序總是由庫說明部分、實體和結(jié)構(gòu)體等三部分構(gòu)成
C.VHDL程序中的實體部分是對元件和外部電路之間的接口進行的描述，可以看成是定義元件的引腳
D.結(jié)構(gòu)體是描述元件內(nèi)部的結(jié)構(gòu)和邏輯功能

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