A.多端式穩(wěn)壓器,輸出電壓可調(diào)
B.三端式穩(wěn)壓器,輸出正電壓可調(diào)
C.多端式穩(wěn)壓器,負(fù)穩(wěn)壓器
D.多端式穩(wěn)壓器,正穩(wěn)壓器
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A.正極性輸出,1.5A
B.負(fù)極性輸出,1.5A
C.正極性輸出,2A
D.負(fù)極性輸出,2A
A.越小
B.越大
C.較適當(dāng)
D.與大小無關(guān)
A.越大
B.與大小無關(guān)
C.較適當(dāng)
D.越小
A.越大
B.較適當(dāng)
C.越小
D.與大小無關(guān)
A.靜態(tài)指標(biāo)
B.動(dòng)態(tài)指標(biāo)
C.穩(wěn)定指標(biāo)
D.質(zhì)量指標(biāo)
最新試題
?MOSFET源極漏極間的長度L越大,溝道長度調(diào)制效應(yīng)越明顯。???
假設(shè)NEMOSFET已工作在飽和區(qū),若uDS繼續(xù)增大時(shí),溝道夾斷點(diǎn)向漏極移動(dòng)。
CG放大器具有較()的輸入電阻和較()的輸出電阻。?
?CD放大器的性能特征有()。?
在下圖中如果輸入輸出均有電容耦合,則將RG的阻值由10MΩ替換為1MΩ時(shí),柵極直流電壓將會(huì)(),漏極直流電流將會(huì)(),輸入電阻將會(huì)()。
?CG放大器的性能描述合理的是()。
用作電壓放大器時(shí),CS放大器不合適的參數(shù)為()。?
?verilogHDL中已經(jīng)預(yù)先定義了的門級(jí)原型的符號(hào)有()。
在對(duì)數(shù)字鐘計(jì)時(shí)、校時(shí)模塊進(jìn)行仿真時(shí),設(shè)秒信號(hào)的周期為10ns,若要觀察24時(shí)制計(jì)數(shù)是否正確,那么在復(fù)位信號(hào)無效,計(jì)時(shí)使能信號(hào)有效的情況下,仿真需運(yùn)行多長時(shí)間?()
?10進(jìn)制計(jì)數(shù)器模塊在數(shù)字鐘系統(tǒng)中可作為以下哪些模塊的子模塊?()