A.由門(mén)電路構(gòu)成的多諧振蕩器
B.石英晶體多諧振蕩器
C.555集成電路構(gòu)成的多諧振蕩器
D.由觸發(fā)器構(gòu)成的多諧振蕩器
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A.輸出信號(hào)與輸入信號(hào)異步
B.各觸發(fā)器翻轉(zhuǎn)異步
C.輸入信號(hào)與時(shí)鐘脈沖異步
D.預(yù)置數(shù)控制與時(shí)鐘信號(hào)異步
A.雙拍接收寄存器存前要清零，單拍不必
B.單拍接收寄存器存前要清零，雙拍不必
C.兩者都必須清零
D.兩者都不必清零
A.同步計(jì)數(shù)器
B.數(shù)碼寄存器
C.譯碼器
D.異步寄存器
A.多諧振蕩器
B.施密特觸發(fā)器
C.單穩(wěn)態(tài)觸發(fā)器
D.石英晶體多諧振蕩器
A.同步型
B.計(jì)數(shù)型
C.移位型
D.異步型
最新試題
具有“有1出0、全0出1”功能的邏輯門(mén)是（）
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
以下代碼中為無(wú)權(quán)碼的為（）。
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線(xiàn)數(shù)n的關(guān)系一般為（）
以下哪個(gè)編碼不能是二－十進(jìn)制譯碼器的輸入編碼（）
7系列EPROM存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
用1M×4的DRAM芯片通過(guò)（）擴(kuò)展可以獲得4M×8的存儲(chǔ)器。
試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案，比較各種方案的特點(diǎn)。如果用HDPLD來(lái)實(shí)現(xiàn)，設(shè)計(jì)方案是最佳嗎？簡(jiǎn)述理由。
基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài)，所以它不能被稱(chēng)為（）觸發(fā)器。
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)，要求輸入每變化20mV，輸出信號(hào)的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。