A.開環(huán)電壓放大倍數(shù)為有限值
B.集成運(yùn)算放大器在線性使用時(shí)，之所以有虛短的結(jié)論，是因?yàn)殚_環(huán)電壓放大倍數(shù)AVDO為∞
C.集成運(yùn)算放大器的輸入阻抗無窮大和輸出阻抗為0
D.集成運(yùn)算放大器在線性使用時(shí)，之所以有虛斷的結(jié)論，是因?yàn)檩斎胱杩筊1為∞
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A.共射電路
B.OCL電路（互補(bǔ)對(duì)稱電路）
C.差分放大電路
D.共集電路
A.扁平式
B.圓外殼式
C.單列直插式
D.雙列直插式
A.直接耦合
B.變壓器耦合
C.阻容耦合
D.電容耦合
A.輸入級(jí)常采用差分放大器
B.中間級(jí)由多級(jí)直接耦合放大器構(gòu)成
C.輸出級(jí)常采用射極輸出器
D.中間級(jí)由多級(jí)阻容耦合放大器構(gòu)成
A.輸入電阻無窮大
B.輸出電阻無窮大
C.通頻帶很寬
D.開環(huán)放大倍數(shù)為0
最新試題
現(xiàn)在定義了一個(gè)1位的加法器addbit（ci，a，b，co，sum），模塊的結(jié)果用表達(dá)式表示為{co，sub}=a+b+ci，其中a，b為兩個(gè)加數(shù)，ci為來自低位的進(jìn)位，sum為和，co為向高位的進(jìn)位，如果以此1位加法器構(gòu)建四位加法器，同時(shí)定義頂層模塊中的端口信號(hào)和中間變量的定義：下面通過層次調(diào)用的方式進(jìn)行邏輯實(shí)現(xiàn)中的表達(dá)式正確的是（）。
?電路如圖所示，如果電容C2開路，則MOSFET的漏極直流電壓將會(huì)（），漏極交流電壓將會(huì)（），增益將會(huì)（）。
用作電壓放大器時(shí)，CS放大器不合適的參數(shù)為（）。?
?CS、CG和CD三種組態(tài)中，最適合做電壓放大器的還是CS放大器。
MOSFET做放大器，要想正常工作只需用電路提供合理的偏置使其工作在飽和區(qū)即可。???
?CG放大器的性能描述合理的是（）。
?verilogHDL的基本結(jié)構(gòu)中通常需要進(jìn)行模塊范圍的定義，VerilogHDL的模塊范圍的定義的開始和結(jié)束方式是（）。
I=0.5mA，Vt=1.5V，k′n（W/L）=1mA/V2，VA足夠大。輸入輸出信號(hào)均通過電容耦合進(jìn)行傳輸（注意圖中未畫出電容），要實(shí)現(xiàn)增益為15倍的放大電路，則RD=（）kΩ。?
CG放大器因其輸入電阻過小，因此沒什么用處。
?數(shù)字頻率計(jì)采用4個(gè)數(shù)字的BCD碼計(jì)數(shù)器，若采樣時(shí)間0.01s，那么它能夠測(cè)量的最大頻率是多少？（）