A.輸入級(jí)常采用差分放大器
B.中間級(jí)由多級(jí)直接耦合放大器構(gòu)成
C.輸出級(jí)常采用射極輸出器
D.中間級(jí)由多級(jí)阻容耦合放大器構(gòu)成
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A.輸入電阻無(wú)窮大
B.輸出電阻無(wú)窮大
C.通頻帶很寬
D.開(kāi)環(huán)放大倍數(shù)為0
A.電壓并聯(lián)
B.電壓串聯(lián)
C.電流并聯(lián)
D.電流串聯(lián)
A.RF=2
B.R1=4RF
C.R1=RF
D.RF=∞
A.加法器
B.電壓跟隨器
C.比較器
D.反相輸入比例運(yùn)算電路
A.降低共模信號(hào)放大能力
B.提高差模信號(hào)放大能力
C.提高電路的對(duì)稱性
D.提高放大倍數(shù)的穩(wěn)定性
最新試題
?verilogHDL中已經(jīng)預(yù)先定義了的門(mén)級(jí)原型的符號(hào)有（）。
?CS放大器中引入源極電阻RS，其作用有（）。?
?在使用verilog描述一個(gè)二選一的數(shù)據(jù)選擇器時(shí)，使用一條語(yǔ)句來(lái)進(jìn)行描述assign out1=（sel &b）∣（~sel &a），這條語(yǔ)句對(duì)應(yīng)的是（）。
I=0.5mA，Vt=1.5V，k′n（W/L）=1mA/V2，VA足夠大。輸入輸出信號(hào)均通過(guò)電容耦合進(jìn)行傳輸（注意圖中未畫(huà)出電容），要實(shí)現(xiàn)增益為15倍的放大電路，則RD=（）kΩ。?
CD放大器具有較（）的輸入電阻和較（）的輸出電阻。?????
當(dāng)VGS=0時(shí)，能夠?qū)ǖ腗OS管為（）
MOSFET做放大器，要想正常工作只需用電路提供合理的偏置使其工作在飽和區(qū)即可。???
?10進(jìn)制計(jì)數(shù)器模塊在數(shù)字鐘系統(tǒng)中可作為以下哪些模塊的子模塊？（）
CG放大器具有較（）的輸入電阻和較（）的輸出電阻。?
?若某放大器的輸入信號(hào)為電壓信號(hào)，輸出信號(hào)為電流信號(hào)，則以下描述正確的有（）。?