A.先升高后降低
B.先降低后升高
C.逐步升高
D.逐步降低
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A.a =a &0x0F
B.a =a ∣0xF0
C.a =a &0xF0
D.a =a∣0x0F
A.信號(hào)是全局量,代表物理連接的導(dǎo)線,有傳遞延遲,可以在PROCESS中使用,但不能在PROCESS中聲明
B.變量是局部量,用于運(yùn)算過程中的暫存載體,無傳遞延遲,只能在PROCESS和子程序中聲明和使用
C.在PROCESS內(nèi)給信號(hào)賦值,賦值動(dòng)作立即發(fā)生,值的更新在END PROCESS處;變量的賦值立即更新
D.信號(hào)和變量都可以在不同的PROCESS內(nèi)聲明和賦值
A.端口名不能和實(shí)體名相同,端口為“in”的信號(hào)不能在結(jié)構(gòu)體中被寫即被賦值
B.端口名不能和實(shí)體名相同,端口為“out”的信號(hào)不能在結(jié)構(gòu)體中作為賦值源送給其他信號(hào)
C.端口名和實(shí)體名不能相同,其“inout”和“buffer”信號(hào)都是可讀可寫的
D.端口名和實(shí)體名可以相同,其“in”和“out”信號(hào)都是可讀可寫的
A.entity 74HC138is
B.entity HC74-138is
C.entity HC74_138is
D.entity HC74_138_
A.VHDL語(yǔ)言是針對(duì)電路功能的描述,其語(yǔ)言具有并行特性
B.電路內(nèi)部的模塊之間用信號(hào)線進(jìn)行連接,因此信號(hào)的傳遞具有延遲特性
C.其語(yǔ)言具有對(duì)電路模型及對(duì)外輸入輸出端口信號(hào)的定義,外部的封裝與管腳也是硬件特性的表現(xiàn)
D.語(yǔ)言與C語(yǔ)言類似,語(yǔ)句執(zhí)行是按照指令一條一條按順序執(zhí)行的
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